Intel-Prozessor

Intel Pentium Pro

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Pentium Pro

Pentium Pro
(1 MB-Version)

Ein geöffneter Pentium Pro. Links ist die CPU und rechts ist der L2-Cache zu sehen.

Der Pentium Pro ist ein Mikroprozessor der Firma Intel. Er stammt aus der x86-/IA-32-Architektur und ist für 32-Bit-Programmcode optimiert. Da er teuer war und bei den damals verbreiteten 16-Bit-Programmen und -Betriebssystemen (insbesondere Windows 95) keine gute Leistung bot, verkaufte er sich deutlich schlechter als von Intel erhofft. Er wurde vorwiegend in teuren Server- und Workstation-Systemen verbaut. Unter den auf diesen Systemen verwendeten 32-Bit-Betriebssystemen (z. B. Windows NT oder Linux) erreichte der Pentium Pro eine deutlich höhere Leistung als ein gleichgetakteter Pentium-Prozessor. Hierfür war auch der mit internem Prozessortakt betriebene L2-Cache verantwortlich. In der Rolle des High-End-Prozessors wurde er später durch die Xeon-Prozessorlinie abgelöst.

Eigentlich sollte der Pentium Pro nach 1995 den Pentium ablösen. Da aber die Produktion eine hohe Ausschussrate hatte (es gab insbesondere Probleme mit dem Onchip-Cache), konnte Intel den Preis nicht so weit senken, dass der Pentium Pro eine weite Verbreitung fand. Stattdessen wurde schließlich der Pentium II als Pentium-Nachfolger entwickelt. Bei diesem sind Prozessorkern und Cache getrennt.

Inhaltsverzeichnis

1 Architektur
2 Modelle
- 2.1 P6 (A80521)
- 2.2 Pentium II OverDrive für Pentium Pro P6T
3 Siehe auch
4 Weblinks

[Bearbeiten] Architektur

Anders, als der Name es vermuten lässt, unterscheidet sich die Architektur des Pentium Pro deutlich von der des früheren Pentium-Prozessors. Der Pentium Pro enthielt einige wichtige neue Konzepte, wie einen RISC-Kern. Er war also kein reiner CISC-Prozessor mehr, sondern eher eine Art Hybrid. Außerdem wurde mit der "Out-of-order execution" ein Konzept eingeführt, welches das Leistungspotenzial erhöhte. Während der Pentium Prozessorkern x86-Code nativ ausführt, enthält der Pentium Pro-Prozessorkern drei parallel arbeitende RISC Pipelines, die mittels dreier Decoder-Einheiten den zugrundeliegenden x86-Code in RISC-Befehle übersetzt. Dieser so prozessorintern modifizierte Programm-Code kann effizienter auf die Pipelines aufgeteilt werden, was eine bessere Parallelität der Befehlsabarbeitung ermöglicht. Kernstück des Pentium Pro ist der P6-Prozessorkern, der später in modifizierter Form dann im Pentium II, Pentium III, Pentium M und schließlich in der aktuellen Intel Core Architektur Verwendung findet. Die P6-Architektur, die den Grundstein für die 686er-Klassifikation legt, war der wichtigste Schritt in der Entwicklung von x86er Prozessoren seit der Einführung des 386ers als 32Bit-CPU mit seiner MMU.

Der 2nd-Level Cache (L2-Cache) und Prozessor-Kern befinden sich im selben Prozessorgehäuse auf zwei (bzw drei beim 1024-kB-Modell) separaten Dies, verbunden durch Bond-Drähte. Es gibt Versionen mit 256, 512 und 1.024 KB L2-Cache. Der ausschließlich für den Sockel 8 erhältliche Prozessor wurde mit den Taktfrequenzen 150, 166, 180 und 200 MHz produziert.

Der Prozessor greift über einen AGTL+-Bus auf Hauptspeicher und andere Systemkomponenten zu. Es ist möglich, ohne weitere Bausteine vier Prozessoren an einem Prozessor-Bus zu betreiben. Für mehr Prozessoren werden Brückenbausteine und andere Tricks benötigt. Solche Server stellten unter anderem HP (Netserver LX Pro8) und ALR (Revolution 6x6) her. Damit war der Pentium Pro der erste wirkliche Server-Prozessor von Intel.

Des Weiteren erhielt die Pentium Pro-Familie auch einen Overdrive-Prozessor, der mit 300/60 bzw. 333/66 MHz spezifiziert war. Dieser war vom Kern her ein Pentium II mit 512 KB L2-Cache, der ebenfalls, und anders als beim Pentium II, mit voller Prozessorgeschwindigkeit lief. Diese Overdrive-Prozessoren wurden lediglich für Zweiprozessorsysteme vom Hersteller zugelassen, da beim Pentium 2 höchstens zwei Prozessoren genutzt werden können.

[Bearbeiten] Modelle

[Bearbeiten] P6 (A80521)

L1-Cache: 8 + 8 KB (Daten + Instruktionen)
L2-Cache bei vollem CPU-Takt:
- 256 kB L2-Cache (alle Taktfrequenzen außer 166 MHz)
- 512 kB L2-Cache (ab 166 MHz)
- 1024 kB L2-Cache (nur 200 MHz)
SMP
Sockel 8, GTL+ mit 60 und 66 MHz Front Side Bus
Betriebsspannung (VCore): 3,3 V
Erscheinungsdatum: 1. November 1995, 18. August 1997 (1.024 KB L2-Cache)
Fertigungstechnik CPU: 0,5 µm (150 MHz) und 0,35 µm (166 - 200 MHz)
Fertigungstechnik L2-Cache: 0,5 µm (256 KB L2-Cache) und 0,35 µm (512 & 1.024 KB L2-Cache)
Die-Größe CPU:
- 0,50 µm: 306 mm² bei 5,5 Millionen Transistoren
- 0,35 µm: 196 mm² bei 5,5 Millionen Transistoren
Die-Größe L2-Cache:
- 0,50 µm / 256 KB L2-Cache: 202 mm² bei 15,5 Millionen Transistoren
- 0,35 µm / 512 KB L2-Cache: 242 mm² bei 31,0 Millionen Transistoren (jeweils die doppelten Werte bei 1.024 KB L2-Cache)
Taktraten: 150 bis 200 MHz
- 256 KB L2-Cache, 66 MHz FSB: 133 MHz (Engineering Sample)
- 256 KB L2-Cache, 60 MHz FSB: 150 und 180 MHz
- 256 KB L2-Cache, 66 MHz FSB: 200 MHz
- 512 KB L2-Cache, 60 MHz FSB: 180 MHz
- 512 KB L2-Cache, 66 MHz FSB: 166 und 200 MHz
- 1.024 KB L2-Cache, 66 MHz FSB: 200 MHz